异步二进制加法计数器.ppt

单击此处编辑母版标题样式,单击此处编辑母版文本样式,第二级,第三级,第四级,第五级,*,*,第6章寄存器与计数器,1,6.1 寄存器与移位寄存器,主要内容：,触发器构成的寄存器,集成寄存器74,LS374/,74,HC374/,74,HCT374,移位寄存器的五种输入输出方式,触发器构成的移位寄存器,4位集成移位寄存器74,LS194,移位寄存器的应用举例,2,6.1.1 寄存器,在数字电路中，用来存放二进制数据或代码的电路称为,寄存器,。,上述寄存器的寄存时间？,1,0,1,0,1,0,1,0,3,集成寄存器74,LS175,4,课外查资料：,了解集成寄存器,74LS373,与74,LS374,。,74,LS175,真值表,5,6.1.2 移位寄存器,移位寄存器的5种输入输出方式：,（,a,）,串行输入,/,右移,/,串行输出,（,b）,串行输入/左移/串行输出,6,（,c,）,并行输入,/,串行输出,（,d,）,串行输入,/,并行输出,7,（,e,）,并行输入,/,并行输出,8,9,1.,串行输入/,串行输出/并行输出,移位寄存器,：,下图所示为边沿,D,触发器组成的4位串行输入/串行输出移位寄存器,。,串行输入,1010,10,（,a,）,寄存器清零,0,0,0,0,0,0,0,11,（,c）,第2个,CP,脉冲之后,（,d）,第3个,CP,脉冲之后,0,0,0,0,12,（,e）,第4个,CP,脉冲之后,1010,13,例6-1,对于图6-4所示移位寄存器，画出下图所示输入数据和时钟脉冲波形情况下各触发器输出端的波形。设寄存器的初始状态全为0。,14,2.,集成电路移位寄存器,常用集成电路移位寄存器为,74,LS194,，,其逻辑符号和引脚图如图所示。,15,16,例,6-2,利用两片集成移位寄存器74,LS194,扩展成一个8位移位寄存器。,17,例,6-3,由集成移位寄存器74,LS194,和非门组成的脉冲分配器电路如图,所示，试画出在,CP,脉冲作用下,移位寄存器,各输出端的波形。,18,6.2,异步,N,进制计数器,主要内容：,异步,n,位二进制加、减计数器电路,异步,n,位二进制计数器电路的构成方法,异步,3,进制加计数器电路,异步,6,进制加计数器电路,异步非二进制计数器电路的构成方法,19,能够对输入脉冲个数进行计数的电路称为,计数器,。,一般将,待计数,的脉冲作为,CP,脉冲,。,电路结构,：,触发器门电路。,N,个触发器可表示,N,位二进制数,。,20,计数器,二进制计数器,十进制计数器,N,进制计数器,加法计数器,同步计数器,异步计数器,减法计数器,可逆计数器,加法计数器,减法计数器,可逆计数器,二进制计数器,十进制计数器,N,进制计数器,21,6.2.1,异步,n,位二进制计数器,1.,异步,2,位二进制加计数器,22,工作原理分析,23,异步,2,位二进制减计数器,24,2.,异步,n,位二进制计数器,其构成具有一定的规律：,(a),异步,n,位二进制计数器由,n,个触发器组成，每个触发器均接成,T,触发器,。,(b),各个触发器之间采用,级联方式,，其连接形式由,计数方式,（加或减）和触发器的,边沿触发方式,（上升沿或下降沿）共同决定。,例子,25,6.2.2,异步非二进制计数器,1.,异步,3,进制加计数器,异步,3,进制加计数器,以异步,2,位二进制加计数器为基础构成。,要实现这一点，必须使用,带异步清零端,的触发器。,计数脉冲,Q,1,Q,0,0,0,0,1,0,1,2,1,0,3,1,1,4,（再循环）,0,0,计数脉冲,Q,1,Q,0,0,0,0,1,0,1,2,1,0,3,（再循环）,0,0,26,异步,3,进制加计数器电路如下,计数到,11,的瞬间就清零,1,1,0,27,异步,3,进制加计数器输出波形：,28,2.,异步非,二,进制计数器,构成方式与上述,3,进制计数器一样，即采用“,反馈清零,”法。,如：异步,6,进制加计数器电路可在,3,位,2,进制加计数器电路基础上实现。,29,异步,6,进制加计数器电路,计数到,110,的瞬间就清零,1,1,0,0,30,6.3,同步,N,进制计数器,主要内容：,同步,2,位二进制加、减计数器电路,同步,3,位二进制加、减计数器电路,同步,n,位二进制计数器电路的构成方式,同步,5,进制加计数器电路,同步,10,进制加法计数器电路,31,6.3.1,同步,n,位二进制,计数器,1.,同步,2,位二进制计数器,32,工作原理分析,33,2.,同步,3,位二进制计数器,34,35,3.,同步,n,位二进制计数器,计数器的构成具有一定的规律，可归纳如下：,（,a,）同步,n,位二进制计数器由,n,个,JK,触发器组成；,（,b,）各个触发器之间采用,级联方式,，第一个触发器的输入信号,J,0,K,0,1,，其它触发器的输入信号由计数方式决定。,36,如果是加计数器则为,：,如果是减计数器则为：,37,6.3.2,同步非,二,进制计数器,同步非,2,n,进制计数器的电路构成没有规律可循，,可采取,“观察”法,，其具体构成过程见书,p158,38,1.,同步5进制加法计数器,39,2.,同步,10,进制加计数器电路,40,6.4,集成,计数器,主要内容：,同步二进制加计数器,74LS161,的逻辑功能,同步十进制加,/,减计数器,74LS192,的逻辑功能,异步二进制加法计数器,74LS93,的逻辑功能,异步十进制加法计数器,74LS90,的逻辑功能,采用,74LS161,构成小于,16,的任意进制加计数器,采用,74LS90,构成小于,10,的任意进制加计数器,采用两片,74LS161,构成小于,256,的任意进制加法计数器,采用两片,74LS90,构成小于,100,的任意进制加法计数器,41,6.4.1,集成同步二进制计数器,其产品多以四位二进制即十六进制为主，下面以典型产品,74LS161,为例讨论。,42,异步清零。当,CLR=0,时，不管其它输入信号的状态如何，计数器输出将立即被置零。,43,同步置数。当,CLR=1（,清零无效）、,LD=0,时，如果有一个时钟脉冲的上升沿到来，则计数器输出端数据,Q,3,Q,0,等于计数器的预置端数据,D,3,D,0,。,44,数据保持。当,CLR=1,、,LD=1,，,且,ETEP=0,时，无论有没有时钟脉冲，计数器状态将保持不变。,45,加法计数。当,CLR=1、LD=1（,置数无效）且,ET=EP=1,时，每来一个时钟脉冲上升沿，计数器按照4位二进制码进行加法计数，计数变化范围为00001111。该功能为它的最主要功能。,进位信号,RCO=ET,Q,3,Q,2,Q,1,Q,0,。,46,例,6-4,用74,LS161,构成十二进制加法计数器。,解：,（1）反馈清零法,47,过渡状态,1100,产生清零信号,48,（2）反馈置数法（假设置数,0001,）,49,0 0 0 1,50,减计数,H,H,L,加计数,H,H,L,D,C,B,A,D,C,B,A,L,L,L,L,L,L,H,Q,D,Q,C,Q,B,Q,A,D,C,B,A,CP,D,CP,U,LD,R,D,输 出,预置数据输入,时钟,预置,清零,异步清零：,异步预置数：,课外：,双时钟4位二进制同步可逆计数器 74,LS193,同步加计数：,同步减计数：,R,D,=1,R,D,=0,LD=0,R,D,=0,LD=1,CP,D,=1,R,D,=0,LD=1,CP,U,=1,51,6.4.2,集成同步非二进制计数器,其产品多以,BCD,码为主，下面以典型产品,74LS192,为例讨论。,52,53,74,LS192,具有以下功能：,(1),CLR=1,时,异步清零,，它为高电平有效。,(2),CLR=0（,异步清零无效）、,LD=0,时,异步置数,。,(3),CLR=0，LD=1（,异步置数无效）且减法时钟,CPD=1,时，则在加法时钟,CPU,上升沿作用下，计数器按照8421,BCD,码进行,递增计数,：00001001。,(4),CLR=0，LD=1,且加法时钟,CP,U,1,时，则在减法时钟,CP,D,上升沿作用下，按照8421,BCD,码进行,递减计数,：10010000。,(5),CLR=0，LD=1，,且,CP,U,1，CP,D,=1,时，计数器输出状态,保持不变,。,54,例6-5,利用反馈置数法，用74,LS192,构成七进制加法计数器。（要求采用预置数据输入：0010。）,解,：,74,LS192,在加计数模式下的状态转换图,如,图,所示，,55,56,6.4.3,集成异步二进制计数器,集成异步二进制计数器在基本异步计数器的基础上增加了一些辅助电路，以扩展其功能。典型产品是,74LS93,。,57,（1）触发器,A,为独立的1位二进制计数器；,（2）触发器,B、C、D,三级为独立的3位二进制计数器（,即八进制,）；,（,3）将两者,级联,可构成4位二进制计数器（即十六进制）；,58,(4)计数器为异步清零，,R,0,(1)、R,0,(2),是清零输入端，且高电平有效。,因此，74,LS93,实际上是一个,二八十六进制,异步加法计数器，采用反馈清零法可构成小于十六的任意进制异步加法计数器。,59,60,例6-6,74,LS93,的内部电路如图所示，采用下面两种不同的级联方式所构成的计数器有何不同？,（1）计数脉冲从,CP,A,输入，,Q,A,连接到,CP,B,；,（2）,计数脉冲从,CP,B,输入，,Q,D,连接到,CP,A,；,61,解：,上述两种级联方式所构成的计数器都是,4位二进制计数器或十六进制计数器。但计数器输出状态的高、低位构成方式不同：,对于级联方式（1）,，二进制计数器为低位，八进制计数器为高位，其输出状态为,Q,D,Q,C,Q,B,Q,A,；,对于级联方式（2）,，八进制计数器为低位，二进制计数器为高位，其输出状态为,Q,A,Q,D,Q,C,Q,B,；,62,6.4.4,集成异步非二进制计数器,其典型产品是,74LS90,（或,74LS290,，两者的逻辑功能相同，但引脚图不同），它的内部电路及引脚图如图所示。,63,64,从图中可以看出：,（1）触发器,A,为独立的1位二进制计数器。,（2）触发器,B、C、D,三级为独立的3位五进制计数器，其计数状态范围为000100。,65,（,3,）将二进制和五进制计数器级联可构成十进制计数器：,如果将,Q,A,与,CP,B,相连,，,CP,A,作为计数脉冲输入端，如图（,a）,所示，则计数器的输出端,Q,D,Q,C,Q,B,Q,A,为8421,BCD,码十进制计数器。,66,工作原理分析,67,如果将,Q,D,与,CP,A,相连,，,CP,B,作计数脉冲输入端，如图（,b）,所示，则输出端,Q,A,Q,D,Q,C,Q,B,为5421,BCD,码十进制计数器。,68,工作原理分析,69,74,LS90,具有以下功能：（1）,异步清零,。（2）,异步置9。,（3）,正常计数,。（4）,保持不变,。,70,例6-,7,分别采用反馈清零法和反馈置9法，用74,LS90,构成8421,BCD,码的8进制加法计数器。,解：（1）,采用反馈清零法。,71,（2）,采用反馈置9法。,首先连接成,8421,BCD,码十进制计数器，然后在此基础上,采用反馈置9法。,8,进制加法计数器的计数状态为1001、00000110，其状态转换图如图（,a）,所示。,72,73,练习:下图是几进制计数器?,答:8进制,Q,D,Q,C,Q,B,Q,A,S,9,(1),S,9,(2),R,0,(1),R,0,(2),CP,B,CP,A,CP,74,LS90,1000为过渡状态，故输出端状态的变化范围:,00000111,74,练习:下图是几进制计数器?,答:7进制,Q,D,Q,C,Q,B,Q,A,S,9,(1),S,9,(2),R,0,(1),R,0,(2),CP,B,CP,A,CP,74,LS90,&,75,练习：,用一片74,LS90,设计九进制计数器,Q,D,Q,C,Q,B,Q,A,S,9,(1),S,9,(2),R,0,(1),R,0,(2),CP,B,CP,A,CP,74,LS90,76,6.4.5,集成计数器的扩展,将两片计数器（分别为模,n,和模,m,）相,串接,，可扩展为,N=nm,的计数器。在此基础上再利用前面介绍的反馈清零或反馈置数的方法，可构成,小于,N=nm,的任意进制,计数器。,例,6-8,用两片,74LS161,构成,256,进制,加法计数器,。,解：,74LS161,有专门的进位信号,RCO,，每片接成十六进制，两片之间串接方式有两种：,77,两片之间串接方式,78,注意：,如果直接将低位片的进位信号,RCO,作为高位片的时钟脉冲，则当第,15,个计数脉冲到来后，低位片输出状态将变成,1111,，使其,RCO,由,0,变为,1,，高位片就开始计数一次。,这时，虽然仍是,256,进制计数器，但计数状态顺序发生了变化,。下面的时序波形图清楚地说明了这一点。,79,例,6-9,用两片,74LS161,构成,204,进制加法计数器。,解：首先将两片,74LS161,串接构成,256,进制加法计数器，然后在此基础上采用“整体反馈清零”或“整体反馈置数”方法构成小于,256,的任意进制加法计数器。,80,图,6-45,例,6-9,：,60,进制加法计数器,81,例,6-10,用两片,74LS90,构成,8421BCD,码的,60,进制加法计数器。,解：首先将每片,74LS90,连接成,8421BCD,码的,10,进制计数器，然后将低位片的进位信号,Q,D,送给高位片的,CP,A,，从而串接成,100,进制计数器。,在此基础上，采用“整体反馈清零”或“整体反馈置数”方法构成小于,100,的任意进制计数器。,82,Q,D,Q,C,Q,B,Q,A,S,9,(1),S,9,(2),R,0,(1),R,0,(2),CP,B,CP,A,CP,74LS90,Q,D,Q,C,Q,B,Q,A,S,9,(1),S,9,(2),R,0,(1),R,0,(2),CP,B,CP,A,CP,74LS90,用,2,片,74LS90,组成,100,进制计数器,100,进制计数器,计数范围,:0099,。,十位,个位,利用,100,进制计数器可构成小于,100,的任意进制计数器。,83,84,85,例,用2片74,LS90,组成24进制计数器,Q,D,Q,C,Q,B,Q,A,S,9,(1),S,9,(2),R,0,(1),R,0,(2),CP,B,CP,A,74,LS90,Q,D,Q,C,Q,B,Q,A,S,9,(1),S,9,(2),R,0,(1),R,0,(2),CP,B,CP,A,74,LS90,CP,计数范围为 0023,R,0,（1）、R,0,（2）,同时为1，输出 清0,先接成100进制计数器,它的进位信号？,86,