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实验八单周期处理器的实现实验目的：进一步理解数据通路、控制通路等基本概念掌握处理器中控制器的基本设计方法进一步理解单周期处理器以及多周期处理器的工作原理和设计思路实验要求：设计和实现一个单周期处理器（60%）可执行至少7条MIPS指令，add、sub、ori、lw、sw、beq、j 编写测试程序的二进制代码，测试实现的电路撰写实验报告，dead line：5.19 设计和实现一个多周期处理器（40%） Dead line：6.6 。实验报告：（1）实验过程 1 控制器的设计与实现控制器的功能根据当前指令，生成处理器内部各部件所需要的控制信号控制器的输入输出输入：op[5:0]，func[5:0] 输出：RegDst，ALUSrc，MemtoReg，RegWrite，MemWrite，Branch，Jump，ExtOp，ALUctr[2:0] 图表 1 主控的设计图表 2 ALUCTR的设计图表 3 控制器的封装 2 ALU的设计与实现 ALU的功能根据控制信号ALUctr[2:0]，将输入端口的两个32位的数据进行加、减、与、或操作，并判断结果是否为0 ALU的输入输出输入：A[31:0]，B[31:0]，ALUctr[2:0] 输出：OUT[31:0]，Zero ALU的实现将运算器实验中实现的加减法扩展为32位增加32位与、或功能增加结果判零电路根据ALUctr[2:0]信号确定ALU的输出图表 4 加法器的设计与封装（由于上一个实验已做成ALU，这里不再赘述加法器的制作）根据ADD/SUB信号判断实现加法或是减法，并且设置Zero项输出，用作Beq指令的判定依据图表 5 加减法器的设计图表 6 ALU的封装三寄存器文件的设计与实现寄存器文件的功能寄存器读：根据Rs，Rt的值读出相应寄存器的值，Rs对应BusA,Rt对应BusB。用多路选择器实现寄存器数据的选择。寄存器写：当RegWR=1时，clk上升沿，将busW的值写入Rw对应的寄存器。用译码器实现寄存器的实现。寄存器文件的输入输出输入：Rs，Rt，Rw，RegWr，busW，clk 输出：BusA，BusB 寄存器文件的实现使用Memory库中的register元件搭建图表 7 寄存器文件的实现四立即数扩展部件的设计与实现立即数扩展部件的功能根据控制信号Extop的值，将十六位的立即数进行符号位扩展（Extop = 1）或者无符号扩展（Extop = 0）立即数扩展部件的输入输出输入：imm16，Extop 输出：imm32 立即数扩展部件的实现当Extop = 1，并且imm16的高位为1时，imm32的高16为全为1 否则，imm32的高16位全为0。因此立即数的高位与ExtOp信号做“与”操作，当且仅当结果为一时做逻辑扩展。图表 8 位扩展的实现五取指部件以及指令存储器的设计与实现取指部件的功能根据当前PC及当前指令，计算下一PC 使用当前PC到指令存储器取指令取指部件的输入输出输入：Jump，Branch，Zero，Imm32，CLK 输出：Instruction[31:0] 取指部件的实现当前指令为普通指令时，PC=PC+4 当前指令为beq指令时，若Zero=1，则 PC = PC + 4 +SignExt[imm16];否则PC=PC+4 当前指令为j指令时，PC={PC<31:28>，target<25:0> ，“00”} 数据在取指传输通路中为30位，当其进入PC时，扩展为32位，但RAM地址只有24位，考虑地址输入到本实验中指令数目较少，只取数据的低二十四位作为RAM地址输入图表 9 取指部件的实现六处理器的封装七处理器的执行第一条指令执行一号寄存器加二号寄存器的值，以3+7为例。并将结果存入三号寄存器。第二条指令将三号寄存器的值存入数据存储器的九号单元第三条指令将数据存储器九号单元的数据存入四号寄存器第四条 10

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